移位时序控制器是高级在轨系统帧同步发送器设计的一部分,通过分析移位时序控制器的特点及其在传输过程中所遇到的各种问题,设计了基于格雷码计数器的移位时序控制器。其硬件电路部分由格雷码计数器、3-8译码器和D触发器构成;软件设计采用Verilog HDL语言,并在Altera Quartus II综合开发平台上给出了其仿真结果。通过仿真效果图可以看出本文设计的移位时序控制器克服了传统的采用二进制计数器的易出错和输出产生毛刺的问题,得到了很好的输出结果。
介绍了一种可编程的平板显示时序控制器的设计。它可以在视频信号源同步信号和外部时钟信号的控制下,根据平板显示器件的分辨率、场刷新频率、数据驱动电路结构等具体条件输出不同频率的时钟、行场同步信号和其他辅助信号。它主要包括两个串行控制总线接口、锁相频率合成器、扫描时序状态寄存器和扫描时序发生电路4部分。锁相频率合成器的设计采用了内、外两分频器的结构,可以合成多种时钟频率,从而满足平板显示器640×480、800×600、1024×768、1280×1024、1600×1200、1920×1080和1280×720七种频率分辨率,50Hz、60Hz、75Hz、85Hz和100Hz五种场刷新频率,双通道和四通道两种数据电路驱动结构的需要。
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